3FPGA工程师
Verilog语言设计/状态机设计/二段式与三段式的对比
三段式状态机是怎么解决输出毛刺问题的？
题目摘要
FPGA工程师面试题：三段式状态机是怎么解决输出毛刺问题的？重点考察三段式通过将输出逻辑独立到第三个always块并可选地寄存输出，从根本上消除组合逻辑毛刺对外部的影响。可结合先说三段式第三个块的两种写法（组合输出 vs...
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：二段式与三段式的对比
- 考察重点：三段式通过将输出逻辑独立到第三个always块并可选地寄存输出，从根本上消除组合逻辑毛刺对外部的影响。
- 作答建议：先说三段式第三个块的两种写法（组合输出 vs 寄存器输出），重点讲寄存器输出如何消除毛刺，再补充这样做带来的一拍延迟代价。
考察要点
三段式通过将输出逻辑独立到第三个always块并可选地寄存输出，从根本上消除组合逻辑毛刺对外部的影响。
答题思路
先说三段式第三个块的两种写法（组合输出 vs 寄存器输出），重点讲寄存器输出如何消除毛刺，再补充这样做带来的一拍延迟代价。
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