3FPGA工程师
Verilog语言设计/状态机设计/状态机输出的寄存器化
输出寄存器化会多一拍延迟，怎么处理？
题目摘要
FPGA工程师面试题：输出寄存器化会多一拍延迟，怎么处理？重点考察寄存器化引入的一拍latency的工程补偿方法，考察实际设计中的权衡能力。可结合先承认这是一个真实存在的问题，然后给出两到三种常用的补偿手段，最后说明如何根据场景选择来组织回答。
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：状态机输出的寄存器化
- 考察重点：寄存器化引入的一拍latency的工程补偿方法，考察实际设计中的权衡能力。
- 作答建议：先承认这是一个真实存在的问题，然后给出两到三种常用的补偿手段，最后说明如何根据场景选择。
考察要点
寄存器化引入的一拍latency的工程补偿方法，考察实际设计中的权衡能力。
答题思路
先承认这是一个真实存在的问题，然后给出两到三种常用的补偿手段，最后说明如何根据场景选择。
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