3FPGA工程师
Verilog语言设计/可综合RTL编码规范/case语句的并行结构
case语句不写full会怎样？怎么处理？
题目摘要
FPGA工程师面试题：case语句不写full会怎样？怎么处理？重点考察非完备case导致锁存器推断的机制，以及default分支和synthesis指令两种解决方案。可结合先解释什么是non-full case，再说明综合工具的推断行为，最后给出两种标准解法并比较来组织回答。
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：case语句的并行结构
- 考察重点：非完备case导致锁存器推断的机制，以及default分支和synthesis指令两种解决方案。
- 作答建议：先解释什么是non-full case，再说明综合工具的推断行为，最后给出两种标准解法并比较。
考察要点
非完备case导致锁存器推断的机制，以及default分支和synthesis指令两种解决方案。
答题思路
先解释什么是non-full case，再说明综合工具的推断行为，最后给出两种标准解法并比较。
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