1FPGA工程师
Verilog语言设计/可综合RTL编码规范/可综合语句与不可综合语句
哪些Verilog语句是不可综合的？能举几个例子吗？
题目摘要
FPGA工程师面试题：哪些Verilog语句是不可综合的？能举几个例子吗？重点考察区分可综合与不可综合语句的基本功，这是RTL编码的底线知识。不清楚这个边界，写出的代码就无法落到硬件上。可结合先给出一个清晰的判断标准——能否映射到确定的硬件电路，然后分类列举典型的不可综合语句，最后点明它们的正...
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：可综合语句与不可综合语句
- 考察重点：区分可综合与不可综合语句的基本功，这是RTL编码的底线知识。不清楚这个边界，写出的代码就无法落到硬件上。
- 作答建议：先给出一个清晰的判断标准——能否映射到确定的硬件电路，然后分类列举典型的不可综合语句，最后点明它们的正确使用场景（仿真/验证）。
考察要点
区分可综合与不可综合语句的基本功，这是RTL编码的底线知识。不清楚这个边界，写出的代码就无法落到硬件上。
答题思路
先给出一个清晰的判断标准——能否映射到确定的硬件电路，然后分类列举典型的不可综合语句，最后点明它们的正确使用场景（仿真/验证）。
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