1FPGA工程师
Verilog语言设计/赋值语义/非阻塞赋值的执行顺序
非阻塞赋值和阻塞赋值，执行顺序上有什么本质区别？
题目摘要
FPGA工程师面试题：非阻塞赋值和阻塞赋值，执行顺序上有什么本质区别？重点考察阻塞赋值（=）与非阻塞赋值（<=）在仿真调度模型中的根本差异，即赋值生效的时间点不同。可结合先点明两者在Verilog仿真调度中分属不同阶段，再分别说明各自的执行时机，最后用一个简单的直觉来总结来组织回答。
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：非阻塞赋值的执行顺序
- 考察重点：阻塞赋值（=）与非阻塞赋值（<=）在仿真调度模型中的根本差异，即赋值生效的时间点不同。
- 作答建议：先点明两者在Verilog仿真调度中分属不同阶段，再分别说明各自的执行时机，最后用一个简单的直觉来总结。
考察要点
阻塞赋值（=）与非阻塞赋值（<=）在仿真调度模型中的根本差异，即赋值生效的时间点不同。
答题思路
先点明两者在Verilog仿真调度中分属不同阶段，再分别说明各自的执行时机，最后用一个简单的直觉来总结。
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