5FPGA工程师
Verilog语言设计/赋值语义/阻塞赋值的执行顺序
阻塞赋值中带 #delay 会怎样影响执行顺序？
题目摘要
FPGA工程师面试题：阻塞赋值中带 #delay 会怎样影响执行顺序？重点考察带延迟的阻塞赋值对仿真调度的影响，包括内部延迟（intra-assignment delay）和前置延迟的区别。可结合区分两种延迟写法的语义差异，用时间线说明仿真器在什么时刻采样右值、什么时刻更新左值来组织回答。
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：阻塞赋值的执行顺序
- 考察重点：带延迟的阻塞赋值对仿真调度的影响，包括内部延迟（intra-assignment delay）和前置延迟的区别。
- 作答建议：区分两种延迟写法的语义差异，用时间线说明仿真器在什么时刻采样右值、什么时刻更新左值。
考察要点
带延迟的阻塞赋值对仿真调度的影响，包括内部延迟（intra-assignment delay）和前置延迟的区别。
答题思路
区分两种延迟写法的语义差异，用时间线说明仿真器在什么时刻采样右值、什么时刻更新左值。
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