3FPGA工程师
Verilog语言设计/赋值语义/assign连续赋值
一个wire信号被多个assign同时驱动，会怎样？
题目摘要
FPGA工程师面试题：一个wire信号被多个assign同时驱动，会怎样？重点考察多驱动（multi-driver）问题的本质、线网解析函数（resolution...
- 岗位方向：FPGA工程师
- 所属章节：Verilog语言设计
- 当前小节：assign连续赋值
- 考察重点：多驱动（multi-driver）问题的本质、线网解析函数（resolution function）、实际工程中的危害与排查方法。
- 作答建议：先说明多驱动在仿真和综合中分别会发生什么，再解释wire的解析规则，最后给出工程中如何避免和排查。
考察要点
多驱动（multi-driver）问题的本质、线网解析函数（resolution function）、实际工程中的危害与排查方法。
答题思路
先说明多驱动在仿真和综合中分别会发生什么，再解释wire的解析规则，最后给出工程中如何避免和排查。
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